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- 电路设计
- Verilog
- CPLD
1.根据项目需求完成硬件的方案设计、逻辑芯片选型,原理图绘制;
2.完成产品CPLD/FPGA逻辑架构设计、程序编写;
3.负责各研发阶段中CPLD/FPGA方面调试,测试和支持;
4.熟练使用Cadence(OrCAD、Allegro)等工具软件。
任职资格:
1.熟练掌握数电、模电等相关基础知识,3年以上相关工作经验,1年及以上FPGA/CPLD开发经验;
2.熟悉Verilog/system Verilog/VHDL等硬件语言,熟练使用主流FPGA/CPLD开发工具及调试工具;
3.清楚FPGA/CPLD设计开发流程,具有相关项目开发经验;
4.服务器、交换机相关经验者优先。
5.有良好的团队合作意识和沟通交流能力,较强的自驱力和责任心。
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公司以无锡为总部,并在南京设立研发中心。获批建设的无锡市级工程技术中心——“自主网络安全工程中心”, 建设了高水平高速信号测试仿真实验室。公司核心成员入选无锡市“太湖人才”、“滨湖之光”等人才计划。目前,公司拥有各类专业技术研发人员100余人,构建了以博士为团队带头人的优秀技术队伍,基本完整建制的软、硬件平台开发团队。
公司成立以来,商业模式、技术实力、经营业绩等得到了政府创投基金、国内头部网络安全厂商和知名投资机构的充分认可,已顺利完成两轮融资,为公司进一步发展壮大提供了充分的战略资源支撑。
公司成功研制了国产申威处理器系列各类网络安全产品、硬件平台、服务器、台式机、模块化一体机、ATCA架构服务器、以太网交换机等,自研了BIOS系统、BMC服务器管理维护系统,可适配Intel、申威、飞腾等多个架构平台。
公司研制了Intel 3rd/4th可扩展至强处理器服务器,正同步开发6th可扩展至强处理器服务器、AI算力平台等数据中心产品;公司及主要产品已获得国家权威机构资质认证,入围国家关键采购名录;国产网络安全产品及平台被国内多个大型网络安全厂商采用,已在全国范围内大规模部署、商用。
工商信息
- 公司名称无锡宏创盛安科技有限公司
- 法定代表人朱泽民
- 成立日期2016-04-12
- 企业类型有限责任公司(自然人投资或控股)
- 经营状态存续
- 注册资金4400.673399万人民币
工作地址
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页面更新时间:2024-12-19