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• 合肥
• 5-10年
• 本科

• 电路设计
• RTL设计
• Verilog
• FPGA

- 设计、实现和调试 FPGA 以加速算法执行（从与周期无关的 C来自BOSS直聘 参考代码开始） - 支持FPGA板卡设计，帮助硬件调配 - 支持主机系统开发人员与FPGA板卡接口 基本要求： - 扎实的 RTL 编码技能，最好使用 Verilog - 从综合到比特流下载和调试，全面掌握 Vivado 或等效的 FPGA 设计工具 - 硕士学历5 年以上或 本科毕业 7 年以上工作经验 首选资格： - 专家级熟悉 Xilinx 和 Altera（英特尔）平台 - 修改最kanzhun初为 FPGA 实现的 ASIC 综合而编写的 RTL 的经验 - 以下一个或多BOSS直聘个领域的领域知识：加密（如 HASH-n；AES）； PCIe； 动态随机存取存储器控制器 ***** 办公室租约在谈中