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AI 芯片 RTL 设计工程师 20-40K
北京海淀区万泉河经验不限硕士
招聘类型:社招、校招、实习 岗位职责: 1. 负责 RISC-V AI 处理器的架构设计和实现,对矩阵运算单元、访存数据通路和片上互联网络等部件进行实现和优化;
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SoC设计工程师(北京) 25-50K
北京海淀区中关村5-10年本科
职位描述 1、负责SoC系统设计,包括:定义spec、SoC集成、IP选型和RTL设计; 2、参与SoC的clock/reset/low power/debug
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资深数字设计工程师-北京 40-70K·14薪
北京海淀区西三旗经验不限本科
工作内容: 1、根据设计需求,完成芯片模块及系统级设计方案及相关文档; 2、完成模块及系统的RTL设计、仿真、综合、时序验证等工作,并满足功能、性能要求; 3、
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ASIC设计工程师-北京-00008 40-70K
北京海淀区苏州桥经验不限本科
比特智路致力于解决当前和未来人工智能与云计算基础设施所面临的可扩展性和通信效率问题。加入我们,你将和我们一起通过技术创新使能未来的人工智能集群扩展到百万张GPU
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CPU设计工程师/专家-北京 35-65K·13薪
北京朝阳区望京5-10年本科
职位描述: 你有机会和业界一流的CPU团队共同开发高性能CPU处理器。作为芯片设计专家,使用最先进的设计平台和工艺,开发与定义下一代CPU微架构流水线方案及实现
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soc设计工程师 35-60K·16薪
北京海淀区清河5-10年本科
岗位职责 1、与架构师团队一起评估与设计PCIE子系统架构; 2、集成和实现 SOC的PCIE 子系统,与SOC同事配合完成所需glue logic RTL的c
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SoC设计工程师 30-60K·15薪
北京海淀区知春路经验不限学历不限
职位描述 1、负责SoC系统设计,包括:定义spec、SoC集成、IP选型和RTL设计 2、参与SoC的clock/reset/low power/debug
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PCIE设计工程师 20-40K·14薪
北京海淀区西直门5-10年硕士
1. 负责PCIe/Interlaken微架构/电路分析以及RTL设计工作 2. 负责DFT设计,协助测试向量生成与测试方案设计 3. 完成PCIe/Inter
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数字设计工程师 30-60K·14薪
北京朝阳区朝外5-10年硕士
职位描述: 1. 参与数字IC需求讨论和规格定义; 2. 完成IP设计文档及相关文档编写。完成RTL设计,自测,各类质量检查,预综合等; 3. 完成测试点
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ASIC设计工程师 20-40K
北京昌平区龙泽5-10年本科
岗位职责: 1、负责信号处理芯片中数字电路的架构设计和RTL开发工作 2、负责设计文档的撰写 3、参与仿真验证及FPGA相关验证支持 4、参与芯片的样品调试和量
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芯片后端设计工程师 30-50K·14薪
北京海淀区北太平庄5-10年硕士
工作职责 1. ASIC IC 设计芯片后端工程师从RTL到GDSII; 2. 布局布线,电源网络设计,时序收敛,功耗分析,物理验证等。 任职要求 1,硕士学
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芯片后端设计工程师 20-35K·14薪
北京海淀区西北旺3-5年本科
岗位职责: 1. 负责全芯片从RTL到GDS并tapeout的全流程工作; 2. 进行层次化切分,建立顶层时钟树,布局布线; 3. 进行IO排布,Bump规划,
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芯片设计工程师(北京) (MJ000602) 30-60K·15薪
北京海淀区学院路5-10年硕士
工作职责: 1.完成SoC芯片的架构设计及方案制定; 2.完成芯片的详细设计,交付RTL/SDC等; 3.完成跨部件沟通和协调,跟进完成芯片的系统集成等工作。
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SOC设计工程师 40-60K
北京海淀区中关村10年以上硕士
1. 负责SOC架构设计及实现:软硬件接口定义、结构设计、RTL代码、文档编写; 2. 负责模块的逻辑仿真和系统的板级调试,定位问题并修改; 3. 负责面积
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数字SOC设计工程师 20-40K·15薪
北京海淀区五道口3-5年本科
职责描述: 1、深度参与芯片规格制定,总体设计。与算法、软件、工具链、架构团队一起软硬件融合、协同设计,定义并完成芯片的详细设计规格; 2、负责芯片前端设计工
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数字IC设计工程师 18-30K·14薪
北京海淀区学院路1-3年本科
岗位职责: 1、参与数字集成电路(IC)的设计和开发,包括但不限于模块级RTL代码编写、仿真验证。 2、负责芯片设计中的前端流程,包括逻辑综合、形式验证、静态时
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数字后端设计工程师 30-60K
北京海淀区学院路3-5年硕士
岗位职责: 1. 协助前端工程师, 参与前期设计 PPA 的评估工作; 2. 负责完成从 RTL 到 GDS 的物理实现; 3. 负责 Block-Level
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资深数字ic设计工程师 30-50K·14薪
北京通州区马驹桥5-10年本科
cache一致性NoC资深设计工程师 【岗位职责】 1) 完成微架构设计及相关工作; 2) 完成RTL实现及相关工作; 3) 协助芯片综合、DFT、后端的设
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资深IC 设计工程师 15-25K·16薪
北京朝阳区望京1-3年硕士
岗位职责: 负责IP和NOC(network-on-chip)从spec 定义, RTL 设计, 验证以及integration 等一直到流片的pre-sili
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ASIC数字设计工程师 35-65K
北京海淀区中关村1年以内硕士
主要职责: 1、专用数字模拟混合信号芯片中数字电路的RTL设计开发工作; 2、电路综合以及基于时序,面积和功耗的设计优化协同系统组一起开发调试FPGA或者芯片
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数字设计工程师(SerDes) 20-35K·16薪
北京朝阳区望京5-10年硕士
岗位职责:主要从事高速接口类数模混合电路IP的逻辑设计与验证,工作内容包括: 1、芯片的架构设计、逻辑设计、代码编写/仿真; 2、Analog Verilog
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数字IC设计工程师 25-35K·14薪
北京海淀区学院路3-5年硕士
岗位职责: 1. 完成Spec指标拆解,模块划分,完成RTL代码设计。 2. 与流程工程师深度合作,完成综合,时序收敛,版图布局等,达成PPA目标。 任职要求:
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数字ic设计工程师 30-50K·14薪
北京海淀区上地3-5年硕士
技能要求: 集成电路,数字电路设计,SOC 技能要求: SOC,ARM,PCIE,C++ 岗位职责: 1.参与存储控制器系统设计,设计软硬件接口,撰写设计文
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资深数字ic设计工程师 30-50K·14薪
北京海淀区学院路5-10年硕士
岗位职责: 1. 完成Spec指标拆解,模块划分,完成RTL代码设计。 2. 与流程工程师深度合作,完成综合,时序收敛,版图布局等,达成PPA目标。 任职要求:
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RISC-V 资深内核设计工程师 40-70K·15薪
北京海淀区知春路5-10年本科
【北京/上海/深圳】 职位描述: 1、RISC-V CPU 芯片core前端开发 ,包括制定cpu架构/微架构,cpu子系统RTL代码开发等; 2、定义及实现
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集成电路设计工程师-(模拟ic) 20-30K·13薪
北京海淀区西二旗在校/应届硕士
岗位职责: 1、负责SOC芯片的模块设计、数字模块及数模接口的技术规范制定与系统设计; 2、负责数字模块设计、数模混合接口设计,包括RTL coding,仿真,
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数字ic设计工程师—2025届校招 20-30K·14薪
北京海淀区清河在校/应届硕士
工作内容: 1. 基于产品需求,定义数字逻辑功能和数模接口; 2. 负责数字控制逻辑架构设计与实现,设计文档的撰写;协助产品问题定位与解决; 3. 完成所负责模
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数字ic设计工程师(PCIE方向) 40-65K·16薪
北京海淀区上地10年以上硕士
岗位职责: 1、参与DPU智能网卡芯片需求讨论与分析,联合芯片架构师完成芯片子系统或模块的规格定义和架构设计; 2、撰写PCIe子系统的微架构设计文档,开发RT
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ASIC设计工程师(网络方向)北/上/杭 40-70K·15薪
北京海淀区中关村3-5年本科
职位描述 1、负责数据中心内ASIC芯片的需求分析、方案设计; 2、负责ASIC微架构设计、RTL开发; 3、支持ASIC验证和集成。 职位要求 1、微电子、计
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2025届-微处理器数字集成电路设计工程师 20-35K·15薪
北京海淀区清河在校/应届硕士
职位描述 微处理器相关部件的RTL设计实现及优化。 职位要求 1. 集成电路、微电子、通信类相关专业硕士及以上学历; 2. 掌握数字集成电路基础知识、熟悉芯片设
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