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• 上海
• 不限
• 本科

• 数字后端
• 物理设计
• PR
• 布局布线
• EMIR
• Signoff
• 功耗
• Power

岗位职责： 1.负责从RTL到GDSII的后端物理实现,包括Floorplan、DFT、Place、CTS、Route、Timing Closure、Eco、EMIR等； 2.负责内部自建案例或客户项目的综合，进行时序约束，UPF/CPF的开发和调试； 3.power signoff, EM/IR分析，timingkanzhun signoff以及对整个chip的全局把握，PPA优化; 4.与项目团队/客户等人员进行协作，解决后端设计过程中遇到的PV/EMIR/Power/STA等相关问题; 5.开发设计流程，使用signoff eda产品进行整体评估，评估EDA产品场景需求和提供相关解决方案； 6.项目研发过程中直聘的技术文档编写、实施方案、设计总结等。 任职要求： 1.微电子学/电子工程/计算机等相关专业本科或硕士以上学历，8年以上工作经验； 2.熟悉主流数字后端设计工具和Timing Sign-off流程，能够独立开发后端设计流程； 3.掌握先进制程PnR/分层次设来自BOSS直聘计流程/低功耗PnR实现/全芯片级布局规划； 4.熟悉低功耗验证流程和形式验证者； 5.熟悉makefile/tcl/bossperl/python/csh/bash等，熟练编写脚本文件； 6.具有SOC(DDR/PCIE/CPU/AI等)量产经验，对参数提取、功耗评估/电源完整性分析/时序分析有深入理解； 7.了解数字前端设计流程，能够独立完成数字电路前端设计实现优先； 8.具备良好的文档编写能力和英文读写能力；熟练使用EDA软件。