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职位描述
- 电路设计
- Verilog
- Perl
1. 负责MEM选型及生成、SUB/TOP 综合，形式验证和静态时序分析，跟进后端反馈时序问题维护SDC质量；
2. 和SOC/IP/DFT/PR等团队紧密合作，全芯片SDC集成，包括phy/io/dft等相关约束；
3. 芯片级timing eco以及timing signoff验收, 产生SDF并协助验证团队进行后仿工作；
4.维护syn/formal/sta相关流程,脚本自动化，检查各个阶段输出质量；
任职要求：
1. 本科及以上；
2. 精通Verilog语言，掌握综合流程和方法，全芯片综合策略；
3. 熟悉Shell/TCL/Perl程序；
4. 理解signoff相关设置及约束脚本实现；
5. 认同公司文化，能够自我激励，并具备团队合作精神；
6. 良好的口语及书面表达能力。
姚女士 今日活跃
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国科微长期致力于视频解码、视频编码、固态存储、物联网等领域大规模集成电路及解决方案开发。公司每年保持高比例研发投入，先后承担了一系列国家、省级重大科研攻关项目，在先进制程工艺的芯片及其终端产品上积累了大量知识产权，具备了快速研发及量产SoC芯片能力。
目前，国科微已先后推出了直播卫星高清芯片、4K/8K超高清解码芯片、4K/8K电视商显芯片、H.264/H.265视频编码芯片、固态存储主控芯片、卫星导航定位芯片等一系列拥有核心自主知识产权的芯片。公司持之以恒进行创新，为客户创造更多价值，推动数字经济高质量发展。
工商信息
- 公司名称湖南国科微电子股份有限公司
- 法定代表人向平
- 成立日期2008-09-24
- 企业类型股份有限公司（上市、自然人投资或控股）
- 经营状态存续
- 注册资金21714.0672万人民币
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页面更新时间：2025-03-17
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